用一个Makefile编译两个目标

Makefile是一种用于自动化构建和编译程序的工具，它可以根据文件的依赖关系和规则来决定哪些文件需要重新编译。通过Makefile，可以将编译过程中的各个步骤自动化，提高开发效率。

在编译两个目标的情况下，可以通过Makefile来实现。以下是一个示例的Makefile文件：

# 定义编译器和编译选项
CC = gcc
CFLAGS = -Wall

# 定义目标文件和依赖关系
TARGETS = target1 target2
OBJS = obj1.o obj2.o

# 默认目标
all: $(TARGETS)

# 目标1的编译规则
target1: obj1.o
    $(CC) $(CFLAGS) -o $@ $^

# 目标2的编译规则
target2: obj2.o
    $(CC) $(CFLAGS) -o $@ $^

# 目标文件的编译规则
%.o: %.c
    $(CC) $(CFLAGS) -c $< -o $@

# 清理生成的文件
clean:
    rm -f $(TARGETS) $(OBJS)

在上述Makefile中，定义了两个目标文件target1和target2，它们分别依赖于obj1.o和obj2.o这两个目标文件。通过定义目标文件的编译规则，可以使用gcc编译器将目标文件编译成可执行文件。同时，还定义了一个默认目标all，它依赖于所有的目标文件。

使用Makefile编译两个目标时，可以在命令行中执行以下命令：

make

这样，Makefile会根据目标文件的依赖关系和规则，自动编译生成target1和target2两个可执行文件。

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