make vs $(MAKE) for submake在makefile中-有什么不同？

在Makefile中，make和$(MAKE)都是用于执行子Makefile的命令。它们之间的区别在于变量的展开方式。

1. make：make是一个命令，用于执行子Makefile。当使用make命令时，它会启动一个新的make进程来执行子Makefile。这意味着子Makefile中的变量将会被重新展开和计算。
2. $(MAKE)：$(MAKE)是一个内置变量，它保存了当前make的命令名称。当使用$(MAKE)变量时，它会展开为当前make的命令名称，并将其作为参数传递给子Makefile。这样子Makefile中的变量将使用相同的值，而不会重新展开和计算。

因此，使用make命令执行子Makefile时，子Makefile中的变量可能会根据当前环境重新计算，而使用$(MAKE)变量执行子Makefile时，子Makefile中的变量将使用相同的值。

在实际应用中，如果子Makefile中的变量不依赖于当前环境，或者需要确保子Makefile中的变量使用相同的值，可以使用$(MAKE)变量。否则，可以使用make命令来重新计算子Makefile中的变量。

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