分享产品试用报告，测试板卡是基于Xilinx Zynq-7000系列XC7Z010/XC7Z020高性能低功耗处理器设计的异构多核SoC工业级核心板。
大侠好，欢迎来到FPGA技术江湖，江湖偌大，相见即是缘分。大侠可以关注FPGA技术江湖，在“闯荡江湖”、"行侠仗义"栏里获取其他感兴趣的资源，或者一起煮酒言欢。
JTAG是1980年代开发的用于解决电子板制造问题的IEEE标准（1149.1）。如今，它可以用作编程，调试和探测端口。但是首先，让我们看看JTAG的最初用途，边界测试。
通过MCU对FPGA对程序进行升级是一种比较方便的方法，程序可以放在U盘或者SD卡之类的地方，随时更新程序。框图如下：MCU首先读取预先存在SD卡或U盘的数据，然后发送给FPGA（需要符合FPGA的时序要求），FPGA的配置方式设置为被动，就可以完成FPGA的在线升级。
Zynq的程序分为三部分，上电启动的引导程序（fsbl），FPGA的程序，arm程序。这里以arm程序存储位置为主进行讨论。
对于FPGA调试，主要以Intel FPGA为例，在win10 Quartus ii 17.0环境下进行仿真和调试，开发板类型EP4CE15F17。主要包括一下几个部分：
XQ138AS-EVM是广州星嵌基于SOM-XQ138S核心板（OMAPL138+Xilinx FPGA）和SOM-XQ138A核心板（OMAPL138+AlteraFPGA）开发的DSP+ARM+FPGA三核评估套件，底板同时兼容两款核心板，用户可以采用该开发套件进行项目前期的验证和评估，也可以直接用来开发自己的产品。
听卖家介绍说，这是之前挖矿盛行时，定制矿机中的一块HASH算力卡，主要功能是通过串口接收数据，FPGA计算出HASH值，再通过串口输出，由于工作频率较高，还外加了散热器，后来由于矿难，就把矿机中的板卡都处理掉了，遗憾的是没有留下任何软硬件资料。
Vivado 设计过程中生成的 bit 流文件需要通过特定的配置引脚导入到 FPGA 中。专用配置引脚上的不同电压级别决定了不同的配置模式。可选的配置模式有：
上一篇文章，介绍了基于STM32F103的JTAG边界扫描应用，演示了TopJTAG Probe软件的应用，以及边界扫描的基本功能。本文介绍基于Xilinx FPGA的边界扫描应用，两者几乎是一样。
make执行GUI 加载编译加入源文件综合出错实现出错生成bitstream出错烧录 flash
对于standalone/freerto应用程序， 在BSP工程的Board Support Package Setting里，可以配置STDOUT/STDIN的物理设备。在standalone或者freertos标签窗口的STDOUT/STDIN的选项下，有none, uart0, uart1, psu_coresight_0等选项。选中psu_coresight_0，重新编译工程。 然后运行工程，打开Xilinx xsct，连接单板，选择“Cortex-A53 #0”，执行jtagterminal，就会启动一个窗口，显示通过psu_coresight_0打印的字符串。
欢迎大侠来到FPGA技术江湖新栏目今日说“法”，当然，在这里我们肯定不是去研究讨论法律法规知识，那我们讨论什么呢，在这里我们讨论的是产品研发以及技术学习时一些小细节小方法等，欢迎大家一起学习交流，有好的灵感以及文章随笔，欢迎投稿，投稿请标明笔名以及相关文章，投稿接收邮箱：1033788863@qq.com。今天带来的是“FPGA的三种配置方式”，话不多说，上货。
对于FPGA工程师除了日常的调试工作以外，批量生产时候指导生成人员下载我们生成的固化文件也是我们的工作，所以今天讲一讲FPGA单独下载<固化文件>的几种方式。
之前介绍过一种远程（无线）更新的方式，详见《起飞！通过无线WIFI下载调试FPGA》，这种方式缺点有两个：一是速度较慢；二是我们的设备中需要增加一个无线设备，增加成本的同时增加了暴露的风险。这两点即无法在调试的时候使用也没办法在实际设备中使用。今天我们再介绍另一种简单方式。
本系列为FPGA系统性学习学员学习笔记整理分享，如有学习或者购买开发板意向，可加交流群联系群主。
今天给大侠带来基于FPGA的电子计算器设计，由于篇幅较长，分三篇。今天带来第二篇，中篇，话不多说，上货。
前面两篇文章介绍了边界扫描的基本原理和BSDL文件，本文文章介绍边界扫描测试实际使用的两款软件工具，在后面的实战应用部分，会演示基于STM32和FPGA的边界扫描测试应用。
试想这样一个场景，我们新设计了一款集成了很多芯片的板卡，包括BGA封装的微控制器，如FPGA/MCU，还有LED、按键、串口、传感器、ADC等基本外设。
二是国产的，各种各样就不放图片了，国产的JTAG基本都是使用逆向Digilent的板载JTAG，使用FT232Hx或者FT2232Hx系列芯片+逆向的固件实现，但是最近FT232Hx和FT2232Hx价格“飞天”，所以我们今天玩点不一样的-逆向官方的开发板-使用FT4232Hx（兼容FT4232HQ和FT4232HL）实现一个多功能JTAG：
今天给大侠带来FPGA Xilinx Zynq 系列第二十三篇，开启十一章，讲述Zynq 片上系统的开发等相关内容，本篇内容目录简介如下：
博主Joel Williams在他的主页中分享了一篇购买便宜的FPGA开发板的攻略，量子位编译本文。
$./petalinux-v2017.3-final-installer.run /opt/pkg/petalinux
于FPGA调试，主要以Intel FPGA为例，在win10 Quartus ii 17.0环境下进行仿真和调试，开发板类型EP4CE15F17。主要包括一下几个部分：
在我们刚开始学习FPGA的时候，我们一般都是将编译后生成的.sof文件（针对于Altera器件）通过JTAG方式下载到FPGA内部，但是我们会发现，给FPGA重新上电之后，我们之前给它下载的程序已经丢失了，如果我们还想让FPGA跑上次的功能就必须再下载一次程序。出现这个问题，是因为我们的程序并没有存到FPGA外接的配置芯片中，只是存在FPGA内部的SRAM。
创龙科技TL5728F-EVM是一款基于TI Sitara系列AM5728（双核ARM Cortex-A15 +浮点双核DSP C66x） + Xilinx Artix-7 FPGA处理器设计的高端异构多核评估板，由核心板与评估底板组成。AM5728与Artix-7在核心板内部通过GPMC、I2C通信总线连接，在评估底板通过PCIe通信总线连接。核心板经过专业的PCB Layout和高低温测试验证，稳定可靠，可满足各种工业应用环境。
1.新装系统后 需要设置su密码： 方法 sudo passwd 提示“Enter new UNIX password” 退出root：su 用户名
最近群里有很多人遇到上述的情况，一直觉得不可思议，以前没有遇到这种情况，如果是很常见的情况，那官网一定有人反馈，如果是极特别的情况，那么也就只能按照BUG处理了。
所有现代FPGA的配置分为两类：基于SRAM的和基于非易失性的。其中，前者使用外部存储器来配置FPGA内的SRAM后者只配置一次。
XQ138F-EVM是广州星嵌电子科技有限公司基于SOM-138F核心板（OMAP-L138+FPGA）开发的DSP+ARM+FPGA三核开发板，采用沉金无铅工艺的4层板设计，它为用户提供了SOM-XQ138F核心板的测试平台，用于快速评估SOM-XQ138F核心板的整体性能。
今天给大侠带来今天带来FPGA 之 SOPC 系列第四篇，NIOS II 外围设备--标准系统搭建，希望对各位大侠的学习有参考价值，话不多说，上货。
在数字IP/IC，FPGA项目的上板验证阶段，对于一些难以确定原因的bug，比如：RTL仿真时，测试pattern覆盖不够全面，fpga跑起来后的实际信号时序可能跟RTL 仿真不一致，从而出现Bug。一种debug的方式就是用FPGA工具提供的ILA模块（xilixn在ISE中叫：chipscope），来实时抓取FPGA内部数字信号的波形，分析逻辑错误的原因，帮助debug。
用过单片机的朋友都知道，单片机芯片内部都有一串序列号，比如STM32，称之为Unique device ID，是一个96Bit的只读数据。
在Xilinx ISE环境下，Chipscope利用 ICON 核通过 FPGA 的 JTAG 端口与内核通信；ILA 核可以用来观察 FPGA 内部信号；VIO 核不仅可以观察信号，还可以将外部输入信号传到 FPGA 中去。
最后就可以生成 bit 流文件。而且小编还看到 Slack 恰好为 0 ，的确是 ”绝了“。
JTAG(Joint Test Action Group)联合测试行动小组)是一种国际标准测试协议（IEEE 1149.1兼容），主要用于芯片内部测试。现在多数的高级器件都支持 JTAG 协议，如 DSP、FPGA 器件等。标准的 JTAG 接口是4线：TMS 、 TCK 、TDI 、TDO ，分别为模式选择、时钟、数据输入和数据输出线。
今天给大侠带来FPGA Xilinx Zynq 系列第十六篇，开启第六章The ZedBoard，本篇内容目录简介如下：
我们在使用Vivado创建工程时，每次都需要选择相关的板卡器件，比较麻烦，这篇文章就教你怎么创建属于自己的板卡文件，在创建工程时就可以像官方板卡一样在板卡列表里选择。
LiteX 框架为创建 FPGA 内核/SoC、探索各种数字设计架构和创建完整的基于 FPGA 的系统提供了方便高效的基础架构。
建议bank0、bank14、bank15的VCCO电压一致，避免出现I/O Transition at the End of Startup（建议按照下表进行配置）
（1）、PULPino datasheet：https://github.com/pulp-platform/pulpino/blob/master/doc/datasheet/datasheet.pdf
上一篇文章，我们介绍了JTAG边界扫描的基础知识，今天我们来看看边界扫描测试必须使用到的一个文件，BSDL文件。
近两年，国外厂商的FPGA芯片价格飙升，由于价格，货期，出口管制等多方面因素的影响，很多公司都在寻找FPGA国产化替代方案。我工作中正在使用的几款芯片也面临停产的风险，用一片少一片，了解到国产FPGA发展的也不错，完全自主知识产权的芯片种类也很多，最近就购买了一块基于高云半导体FPGA芯片的开发板——Tang Nano 4K，学习一下国产FPGA的开发和使用。
本篇介绍了一个简单计算器的设计，基于 FPGA 硬件描述语言 Verilog HDL，系统设计由计算部分、显示部分和输入部分四个部分组成，计算以及存储主要用状态机来实现。显示部分由六个七段译码管组成，分别来显示输入数字，输入部分采用4*4矩阵键盘，由0-9一共十个数字按键，加减乘除四个运算符按键，一个等号按键组成的。通过外部的按键可以完成加、减、乘、除四种功能运算，其结构简单，易于实现。本篇为本人毕业设计部分整理，各位大侠可依据自己的需要进行阅读，参考学习。
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