JTAG(Joint Test Action Group)联合测试行动小组)是一种国际标准测试协议（IEEE 1149.1兼容），主要用于芯片内部测试。现在多数的高级器件都支持 JTAG 协议，如 DSP、FPGA 器件等。标准的 JTAG 接口是4线：TMS 、 TCK 、TDI 、TDO ，分别为模式选择、时钟、数据输入和数据输出线。
JTAG（Joint Test Action Group）是一个接口，为了这个接口成立了一个小组叫JTAG小组，它成立于1985年，比推丸菌的年龄还大。在1990年IEEE觉得一切妥当，于是发布了 IEEE Standard 1149.1-1990，并命名为 Standard Test Access Port and Boundary-Scan Architecture，这就是大名鼎鼎的JTAG了。
作为一名嵌入式工程师，相信大家都十分清楚MCU开发或者ARM开发都避免不了关键的研发过程，产品研发过程中的程序调试更是举足轻重般的存在。
JTAG有10pin的、14pin的和20pin的，尽管引脚数和引脚的排列顺序不同，但是其中有一些引脚是一样的，各个引脚的定义如下。
听卖家介绍说，这是之前挖矿盛行时，定制矿机中的一块HASH算力卡，主要功能是通过串口接收数据，FPGA计算出HASH值，再通过串口输出，由于工作频率较高，还外加了散热器，后来由于矿难，就把矿机中的板卡都处理掉了，遗憾的是没有留下任何软硬件资料。
你以为你不知道，其实它一直就在你身边，JTAG是嵌入式开发中在熟悉不过的一个名词了，但是你真的很了解他吗，来一块趴一趴JTAG的那些事，今天先来看一些基础知识 JTAG 简介 JTAG是英文“Joint Test Action Group（联合测试行为组织）”的词头字母的简写，该组织成立于1985 年，是由几家主要的电子制造商发起制订的PCB 和IC 测试标准。JTAG 建议于1990 年被IEEE 批准为IEEE1149.1-1990 测试访问端口和边界扫描结构标准。该标准规定了进行边界扫描所需要的硬件和
JTAG(Joint Test Action Group；联合测试行动小组)是一种国际标准测试协议（IEEE 1149.1兼容），主要用于芯片内部测试及对系统进行仿真、调试。
随着工艺速度的提高，从嵌入式跟踪宏单元（ETM）获取芯片的跟踪信息越来越困难。这导致了在保持可接受的信号质量方面的困难，或者信号需要被解复用到非常多的跟踪端口引脚上。
应该就是解惑了，ESP32可以使用JTAG来调试，这12-14就是JTAG的引脚。
分享产品试用报告，测试板卡是基于Xilinx Zynq-7000系列XC7Z010/XC7Z020高性能低功耗处理器设计的异构多核SoC工业级核心板。
JTAG主要使用的有：TRST，TDI，TMS，TCLK，TDO，RESET，GND，（VCC可不连接） SWD主要使用的有：VCC，SWDIO，SWCLK，GND
本科所学专业就是IoT，面试安全岗位时大部分面试官都会问我写IoT安全相关的东西，花了半天的时间整理了下本科期间做过的有关IoT安全的技术、demo等。
TCK在IEEE1149.1标准里是强制要求的。TCK为TAP的操作提供了一个独立的、基本的时钟信号，TAP的所有操作都是通过这个时钟信号来驱动的。
最近在搞路由器的时候，不小心把CFE给刷挂了，然后发现能通过jtag进行救砖，所以就对jtag进行了一波研究。
今天给大侠带来今天带来FPGA 之 SOPC 系列第四篇，NIOS II 外围设备--标准系统搭建，希望对各位大侠的学习有参考价值，话不多说，上货。
Boundary-scan is an integrated method for testing interconnects on printed circuit boards (PCBs) that are implemented at the integrated circuit (IC) level.
在前文中，我们了解了IoT技术的基本架构，本文我将来说说IoT安全，在此过程中，我们会尝试定义一种新方法来理解IoT安全，同时也会创建一个结构化流程来方便认知IoT相关的攻击研究和渗透测试。 依据前文我们定义的IoT体系结构，现在我们可以非常清晰地分离出物联网系统的各种组件，并尝试为每种组件定义攻击面，各种组件的攻击面组合将形成一个整体的物联网生态系统攻击面。 我之所以把它称为物联网生态系统而不是物联网产品，是因为它确实是一个由不同组件组成的生态系统，它们相互通信并解决特定的现实问题。 我们先来详细讨论
大侠好，欢迎来到FPGA技术江湖，江湖偌大，相见即是缘分。大侠可以关注FPGA技术江湖，在“闯荡江湖”、"行侠仗义"栏里获取其他感兴趣的资源，或者一起煮酒言欢。
三星S3C6410的底板Jtag接口是10针，而普通的Jlink的接口是20针。因此就需要接口转换，下面给出相关引脚接口图：
UART：全称 Universal Asynchronous Receiver/Transmitter，中文可译为通用异步收发器。
你以为你不知道，其实它一直就在你身边，JTAG是嵌入式开发中在熟悉不过的一个名词了，但是你真的很了解他吗，来一块趴一趴JTAG的那些事，今天来学习JTAG指令 JTAG指令 JTAG控制器执行IEEE
对于esp32c3裸机开发，用openocd结合gdb非常的有用，这是裸机开发的关键工具。
JTAG的RTCK 11脚对应的就是SWD的SWCLK 9
我们在使用Vivado创建工程时，每次都需要选择相关的板卡器件，比较麻烦，这篇文章就教你怎么创建属于自己的板卡文件，在创建工程时就可以像官方板卡一样在板卡列表里选择。
今天给大侠带来基于FPGA的电子计算器设计，由于篇幅较长，分三篇。今天带来第二篇，中篇，话不多说，上货。
对于FPGA调试，主要以Intel FPGA为例，在win10 Quartus ii 17.0环境下进行仿真和调试，开发板类型EP4CE15F17。主要包括一下几个部分：
stm32下载程序，实用JLink的JTAG下载座，分为实现JTAG的下载和SW的下载
今天给大侠带来FPGA Xilinx Zynq 系列第十六篇，开启第六章The ZedBoard，本篇内容目录简介如下：
通过MCU对FPGA对程序进行升级是一种比较方便的方法，程序可以放在U盘或者SD卡之类的地方，随时更新程序。框图如下：MCU首先读取预先存在SD卡或U盘的数据，然后发送给FPGA（需要符合FPGA的时序要求），FPGA的配置方式设置为被动，就可以完成FPGA的在线升级。
欢迎大侠来到FPGA技术江湖新栏目今日说“法”，当然，在这里我们肯定不是去研究讨论法律法规知识，那我们讨论什么呢，在这里我们讨论的是产品研发以及技术学习时一些小细节小方法等，欢迎大家一起学习交流，有好的灵感以及文章随笔，欢迎投稿，投稿请标明笔名以及相关文章，投稿接收邮箱：1033788863@qq.com。今天带来的是“FPGA的三种配置方式”，话不多说，上货。
上一篇文章，介绍了基于STM32F103的JTAG边界扫描应用，演示了TopJTAG Probe软件的应用，以及边界扫描的基本功能。本文介绍基于Xilinx FPGA的边界扫描应用，两者几乎是一样。
博主Joel Williams在他的主页中分享了一篇购买便宜的FPGA开发板的攻略，量子位编译本文。
二是国产的，各种各样就不放图片了，国产的JTAG基本都是使用逆向Digilent的板载JTAG，使用FT232Hx或者FT2232Hx系列芯片+逆向的固件实现，但是最近FT232Hx和FT2232Hx价格“飞天”，所以我们今天玩点不一样的-逆向官方的开发板-使用FT4232Hx（兼容FT4232HQ和FT4232HL）实现一个多功能JTAG：
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最近群里有很多人遇到上述的情况，一直觉得不可思议，以前没有遇到这种情况，如果是很常见的情况，那官网一定有人反馈，如果是极特别的情况，那么也就只能按照BUG处理了。
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我们买开发板的目的就是把电脑上编写编译好的程序烧写到板子上验证学习。因此开发板上一定有个烧写口，例如JTAG烧写口。但电脑上是不会有这个JTAG口的，因此需要一个USB烧写器将两者连接，例如Jlink、OP/EOP。Jlink本来用的人很多，但随着版权意识的提高以及Jlink公司对盗版的打击，Jlink现在用得越来越少了。EesyOpenJtag是OpenJtag的便宜版本，他和我们的开发板是绝配，他可以直接烧写Nand Flash和Nor Flash，操作简单，价格便宜。
（1）、PULPino datasheet：https://github.com/pulp-platform/pulpino/blob/master/doc/datasheet/datasheet.pdf
本文档主要介绍Zynq-7010/7020开发板的硬件接口资源以及设计注意事项等内容。
所有现代FPGA的配置分为两类：基于SRAM的和基于非易失性的。其中，前者使用外部存储器来配置FPGA内的SRAM后者只配置一次。
1、接口说明 单板结构示意图，正面 1.png 单板结构示意图，反面 2.png 单板接口说明 1 单板总电源接口，12V@2A 或以上 2 菜单键，接到GPIO14_6 0：按键按下； 1：按键未按下。 3 升级键，接到GPIO0_0/UPDATE_MODE_N。 0：按键按下； 1：按键未按下。 4 开机键，接到PWR_BUTTON0。 0：按键按下； 1：按键未按下。 开机：按200 毫秒或以上（默认），关机：长按10 秒。 5 系统复位键。复位：按键按下。
今天给大侠带来今天带来FPGA 之 SOPC 系列第五篇，Nios II软件使用与程序开发 I，希望对各位大侠的学习有参考价值，话不多说，上货。
•控制和接入组件：•DAP(Debug Access Port)：用来连接外部硬件调试工具的物理接口，允许外部调试工具访问芯片上CPU、CoreSight、DDR等。•ECT(Embedded Cross Trigger)•跟踪数据源：跟踪源是CoreSight中用于产生跟踪信息的组件。每个跟踪源组件都会产生一种格式的信息，最终可以组合在一起并且通过跟踪链接到输出端口。•PTM(Program Trace Macrocell)：监控处理器运行状况，将处理器执行过的指令信息进行压缩传输。•STM(System Trace Macrocell)：捕捉系统的事件信息并以获取数据跟踪形式传输到跟踪漏斗或跟踪输出组件。•ETM(Embedded Trace Macrocell)：监控处理器运行状况，将处理器执行过的指令信息进行压缩传输。跟踪指令执行、数据搬运、PE(Processing Element)事件。•连接：•Synchronous 1:1 ATB bridge：•Replicator：可以把单个输入复用到两个分支输出，可以使得CoreSight系统跟踪信息同时传输到两个或多个输出。•Trace Funnel：把CoreSight系统中多个跟踪源产生的信息组合在一起并以单个流输出到高级跟踪总线ATB。Funnel之间可以级联，一个Funnel最多可以支持6个跟踪源信息输入。•跟踪输出节点：•TPIU(Trace Port Interface Unit)：把捕捉到的数据导出到外部调试适配器，如DSTREAM。•ETB(Embedded Trace Buffer)：是芯片内一块RAM，用来存储捕捉到的跟踪信息。可以通过DAP访问存储在ETB中的数据。•TMC(Trace Memory Controller)：在芯片设计时可配置，配置成ETB时跟上面介绍的ETB功能一致。还可以配置成ETR和ETF。•ETR(Embedded Trace Router)：把跟踪数据存储到调试目标平台的系统内存上，存储系统内存空间是可配置的。•ETF(Embedded Trace FIFO)：主要是缓冲数据的输出，尤其当当量数据在瞬间产生式，通过ETF可以平滑数据的输出速率。缓存可以被配置为FIFO或Circular Buffer；FIFO满了之后就会反压，源头停止输出跟踪数据；Circular Buffer满了后则会覆盖。
Vivado 设计过程中生成的 bit 流文件需要通过特定的配置引脚导入到 FPGA 中。专用配置引脚上的不同电压级别决定了不同的配置模式。可选的配置模式有：
前面两篇文章介绍了边界扫描的基本原理和BSDL文件，本文文章介绍边界扫描测试实际使用的两款软件工具，在后面的实战应用部分，会演示基于STM32和FPGA的边界扫描测试应用。
随着技术的发展，32位机的市场迅速占领以前8位机的很多领域，相信很多的现在做32位机应用开发的攻城狮都是由做8位机转过来，那么在32位机下做开发和以前有什么不同呢？你还在简单的把32位机当单片机用吗？下面这篇文章告诉你大不同。 ARM处理器在全球范围的流行，32位的RISC嵌入式处理器已经成为嵌入式应用和设计的主流。与国内大量应用的8位单片机相比，32位的嵌入式CPU有着非常大的优势，它为嵌入式设计带来丰富的硬件功能和额外的性能，使得整个嵌入式系统的升级只需通过软件的升级即可实现。而8位处理器通常受到的64
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