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单线程多核处理器上的数据可见性
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线程在内核1上运行，并将x更改为5，该线程仍然在缓存中，并且还没有刷新到主内存，因为我们没有使用任何内存屏障。
线程读取x的值。如果“缓存一致性”管理一致性以处理上述情况，那么为什么在多线程程序中需要显式锁定(或任何读/写障碍)？
浏览 5提问于2016-10-26得票数 4
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malloc()和free()用于分配和释放主内存中的空间。这是否意味着在调用寄存器(或cpu缓存)时，在主内存空间和寄存器(或cpu缓存)之间没有数据传输？如果没有，是否有类似的操作/功能来分配和释放磁盘上的空间，而不需要在磁盘上的空间和主内存之间进行数据传输？
谢谢。
浏览 2提问于2015-02-12得票数 0
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缓存还是注册-哪个更快？
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如果这里问错了，我很抱歉，但是我一直在寻找不同的答案。我的问题是：据我所知，寄存器是直接加载数据来执行它的，而缓存只是CPU内部的一个存储位置。以下是我发现的让我困惑的消息来源：
那到底是哪一个？
浏览 2提问于2013-01-24得票数 33
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当涉及到诸如MESI之类的高速缓存一致性协议时，CPU寄存器和CPU高速缓存之间是什么关系？如果某个值存储在CPU的缓存中，也存储在寄存器中，那么如果缓存线被标记为“脏”，会发生什么？据我所知，即使缓存被更新了(由于MESI)，也没有gurentee保证寄存器会更新它的值。// Blocks indefinitely (让我们假设编译器没有在循环外优化&
浏览 0提问于2009-12-27得票数 4
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当我们有一个支持某种形式多线程的CPU时，每个逻辑CPU都有它自己的一组寄存器(最低限度)，包括一个CR3寄存器。由于在执行不同线程时，我们正在处理同一个进程的虚拟地址空间，并且从未发生上下文切换(在切换同一进程的线程时，TLB缓存都不会失效)，为什么我们需要一个CR3寄存器来指向逻辑CPU中的页表和页目录？该值不总是与物理CPU的CR3中的值相同吗？
浏览 3提问于2017-11-04得票数 2
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我有一个带有ECC和Xeon E3 CPU的系统。但是，存储在Intel CPU中的内存中的随机位错误会发生什么呢？例如缓存和/或寄存器？
是不是有一个覆盖洞，好的RAM被缓存到CPU中，这个缓存的RAM随后被损坏，然后被CPU使用(不检查ECC RAM)？我在英特尔网站上找不到任何信息，除了线上的Xeon E7's关于<
浏览 0提问于2014-08-14得票数 2
因此，我开始讨论多核CPU是否允许并行执行独立的进程。
据我所知，每个内核允许执行不同的线程，但它们都必须属于一个进程。还是我错了？我的理由是，虽然每个核心都有单独的寄存器和L1/L2缓存(取决于硬件)，但它们都必须共享其他东西，如L3缓存或TLB (我对cpu架构了解不多，所以请随时纠正我)。
浏览 0提问于2016-02-26得票数 2
考虑从L1缓存访问内存的最佳情况。它通常需要4个cpu周期(参考)，而寄存器访问需要一个cpu周期。因此，简单地比较寄存器之间的mov指令，例如“movl%eax，%ebx”与包含内存的mov指令"movl (%eax)，%ebx"，后者是否总是比前者多花费4个周期？如果是，CPU在等待内存数据时会做什么？
浏览 1提问于2018-04-04得票数 0
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据我所知，那里有不稳定和非易失性的记忆。给我的问题是，在1到4的范围内，对每种类型的记忆的波动性进行评分。
这是否一个正确的解决办法？
浏览 4提问于2015-04-18得票数 0
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我一直在读关于缓存内存的文章，我从Quora这里找到了一个有趣的答案。但在这里，我有点困惑于CPU是否想处理RAM中的数据，那么它是否通过如下方式：还是指令通过内存总线直接传递给寄存器？
浏览 3提问于2016-03-28得票数 4
今天的计算机架构正试图最大限度地增加寄存器的数量。访问寄存器(它是cpu附近的集成内存电路)比访问一级缓存要快。问题是，每个上下文开关都必须将所有寄存器保存到缓存中，因为下一个线程需要其他寄存器值。现代CPU所做的是在一秒内循环到100个任务，每次它保存寄存器，并取旧寄存器，直到任务可以启动。
使用一个CPU来完成一个任务是很好的，并且不会发生上下文切换。这意味着我们得到100个CPU</e
浏览 0提问于2018-04-04得票数 3
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什么是CPU寄存器？
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我读过一些关于它的内容，它看起来非常类似于我一直所知道的处理器缓存。
当我认为两者是一样的时候，两者之间有什么区别吗?还是我说得对？寄存器是否确实需要在CPU内才能工作？根据维基百科的说法，寄存器是CPU中的一个地方，在那里可以快速访问和修改内存，然后再发送回RAM。我是否理解错了，还是缓存和注册实际上是一样的？
浏览 0提问于2013-08-28得票数 32
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调试器内存监视/缓存内存检查
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我正在尝试调试一个程序，该程序部分地使用缓存的数据内存和缓存的指令内存。问题是在尝试检查这样的内存时，调试器是如何工作的。在检查特定位置时，它是否访问缓存的副本？如果是这样的话，它是否真的修改了缓存，因为一旦数据丢失，它就必须获取数据？这是否意味着程序在调试器下的行为可能与没有调试器的程序不同？有没有办法调试与缓存相关的问题，而不需要调试器来影响缓存？更新：特定的CPU核心是ARM Cortex-A
浏览 4提问于2016-04-22得票数 1
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我知道寄存器作为CPU访问数据的存储单元，以便执行指令。这些指令的汇编语言类似于ADD R2、R1、R3，本质上要求我们在R1和R3中添加内容，并将其放在R2中。我的问题是，数据如何进入寄存器R1和R3，以便CPU可以使用这些值计算结果并将其存储在R2中？如果所有寄存器都满了，是否使用LRU方法将数据从寄存器中逐出到主内存，类似于如何从缓存中驱逐数据？
浏览 3提问于2022-02-05得票数 0
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当cpu执行程序时，它是否通过内存管道移动所有数据？然后，任何数据都将从ram->cache->寄存器中移动，因此所有执行的数据都会在某个时候进入cpu寄存器。或者它是否以某种方式选择了它放置在那些更快内存类型中的代码，或者作为程序员，您是否可以选择您想要保存的特定代码，例如用于优化的缓存？
浏览 0提问于2015-01-08得票数 9
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在ARM体系结构中，在读取CPU关闭序列时，我发现了以下步骤：
清洁L1是什么意思？它是否意味着删除L1的所有内容？那么L2的清洁状态意味着什么呢？
浏览 4提问于2014-12-23得票数 0
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在C语言程序设计中，为了保存CPU寄存器中的任何变量，我们使用了register说明符。类似地，在java中将对象保存在CPU缓存中，在java中是否有一个说明符？
浏览 1提问于2013-01-15得票数 2
人们谈论的‘缓存’没有被刷新到主内存，但这个缓存在哪里？它是否位于JVM中，是CPU内存缓存，还是CPU寄存器？
浏览 3提问于2017-10-01得票数 0
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