循环步长和高速缓存线
循环步长（Loop Stride）是指在循环中对数组或矩阵进行访问时，每次迭代时所跳过的元素个数。循环步长可以用来优化循环的性能，特别是在处理大规模数据时。
循环步长的优势在于可以减少内存访问的次数，从而提高程序的执行效率。通过增加循环步长，可以减少循环迭代的次数，从而减少了循环控制的开销。这对于需要重复访问大规模数据的算法来说尤为重要，比如图像处理、矩阵运算等。
在循环步长的选择上，需要根据具体的应用场景和数据结构来进行权衡。较大的循环步长可以提高程序的执行速度，但可能会增加内存访问的不连续性，导致缓存未命中的情况增加。较小的循环步长可以减少缓存未命中的情况，但可能会增加循环控制的开销，降低程序的执行效率。
高速缓存线（Cache Line）是计算机体系结构中的一个概念，指的是高速缓存中的最小可分配存储单元。高速缓存线的大小一般为64字节或者128字节，具体取决于处理器的架构。
高速缓存线的优势在于可以提高内存访问的效率。当程序访问内存时，处理器会将连续的内存数据块加载到高速缓存线中，以提高后续对内存的访问速度。如果程序访问的数据与高速缓存线对齐，那么可以直接从高速缓存中读取数据，而不需要访问主存，从而减少了内存访问的延迟。
在编程中，可以通过优化数据结构和算法，使得数据访问的模式更加符合高速缓存线的特点，从而提高程序的执行效率。比如可以使用数组代替链表，将数据紧凑地存储在内存中，减少不必要的指针跳转；可以使用局部性原理，尽量利用已经加载到高速缓存中的数据，减少对主存的访问。
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- 云存储（Cloud Object Storage，COS）：提供安全可靠的对象存储服务，适用于存储和处理各种类型的数据。详情请参考：https://cloud.tencent.com/product/cos
- 人工智能平台（AI Platform）：提供丰富的人工智能服务和工具，包括图像识别、语音识别、自然语言处理等。详情请参考：https://cloud.tencent.com/product/ai
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首先，我在这里只找到了，这并没有回答以下问题:为什么有两个截然不同的值。两者都应与缓存线大小相同。那么，什么样的缓存架构可以强制要求有两个不同的值呢？
浏览 1提问于2019-12-18得票数 4
我们都知道以下代码的性能会很低，因为在每次迭代中，CPU都会从内存中加载新的元素s。
#define N a very large number
struct{
float m;
int x[N]
} S;
void main(){
struct S s[elements];
...
//working with data
for (i=0; i<elements;i++){
total+=s[i].m;
}
...
}
如果N很小，并且种类s的elements可以保存在缓存中，那么它是非常快的。否则，CPU将总
浏览 0提问于2014-10-13得票数 0
1回答
for ( i =0; i < 2; i++)
for( j = 0 ; j < 2: j++)
dst[j][i] = src[i][j];
对于具有8字节高速缓存线和总高速缓存大小为16字节的高速缓存，回答键说：“请注意，每个高速缓存线正好持有阵列的一行，高速缓存大小正好足以容纳一个阵列，并且src和dst的第i行映射到相同的高速缓存线。”
因此，这种映射会导致非常具体的逐出。因为第一高速缓存线被逐出并用dst替换，所以它也未命中，而不是src仅具有for和1。为什么缓存没有驱逐第二个缓存线，它可能没有包含任何东西或者src的11。为什么src和dst的0行必须映射到相同的
浏览 33提问于2018-06-04得票数 1
我感兴趣的是微调有缓存意识的数据结构(例如，参见或Herlihy等人的中的无锁跳过树)，以及在并发数组处理期间防止。我已经知道如何通过"sun.arch.data.model“属性找到JVM指针的大小，但是我还没能找到一种方法来确定L1缓存中缓存线的大小。
请注意，这些信息并不重要，因为我可以继续使用保守的L1行大小估计值(当微调有缓存意识的数据结构时为64字节，或者在防止错误共享时为256字节)；但是，如果很容易获得L1缓存属性，那么我不妨使用它。
浏览 3提问于2013-07-01得票数 4
有人能解释一下，为什么numpy.einsum('ij，ji'，A，B)比numpy.einsum('ij，ij'，A，B)慢得多，如下所示？
In [1]: import numpy as np
In [2]: a = np.random.rand(1000,1000)
In [3]: b = np.rand
浏览 21提问于2019-11-14得票数 0
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3回答
我正在尝试学习一些关于缓存的东西。假设我有一个4路32KB的缓存和1 1GB的RAM。每条高速缓存线为32字节。因此，我知道RAM将被分成256个4096KB的页，每个页映射到一个缓存组，其中包含4个缓存线。
我有多少个缓存路？我甚至不确定什么是缓存方式。有人能解释一下吗？我做了一些搜索，最好的例子是
但我还是很困惑。
谢谢。
浏览 2提问于2014-02-07得票数 17
2回答
当处理器预取数据的高速缓存线时，它是从该地址预取到字节数，还是从该地址预取到高速缓存线的一半并向后预取到高速缓存线的一半？
例如，假设高速缓存线是4个字节并且从地址0x06预取。它是从0x06 0x07 0x08 0x09获取字节，还是从地址0x04 0x05 0x06 0x07预取。
我需要为我正在编写的程序，并需要优化这些信息。
浏览 1提问于2013-09-11得票数 2
我有两个与硬件相关的问题：
1- CPU缓存线大小是否可由操作系统修改，或者是否已在CPU中硬连线？可以在Linux上使用getconf -a查看缓存线的大小。
2-假设我的数据缓存线大小是64 bytes，数据是如何从内存传输到CPU的？是并行传输吗？(意思是总线上有64*8 = 512的小电线来一次移动所有的比特)，或者它的串行传输？
3-当我们在这里的时候，我有第三个问题。Cache placement policies的逻辑是如何嵌入到中央处理器中的，是否有软件驱动它(如果有，软件存储在哪里)还是逻辑以某种方式在硬件中？
浏览 0提问于2020-11-25得票数 1
1回答
我正在尝试理解缓存颠簸，下面的文本正确吗？
以下面的代码为例。
long max = 1024*1024;
long a(max), b(max), c(max), d(max), e(max);
for(i = 1; i < max; i++)
a(i) = b(i)*c(i) + d(i)*e(i);
ARM Cortex A9是四路组相联的，每个高速缓存线为32字节，总高速缓存为32kb。总共有1024条高速缓存线。为了执行上述计算，必须移位一个高速缓存线。当要计算a(i)时，b(i)将被去掉。然后，当循环迭代时，需要b(i)，因此另一个向量被移位。在上面的示例中，没有
浏览 0提问于2014-02-04得票数 3
我有2个线程分别绑定到2个cpu核心。 线程A和线程B具有相同的缓存线数据。 如果我修改了缓存线数据并在线程A中调用_mm_clflush (void const* p)。 线程B中的缓存线(L1、L2、L3)将变为无效，并且只能再次从主内存中读取。 是这样吗？
浏览 111提问于2020-12-29得票数 1
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我正在阅读一些关于高速缓存一致性的MESI协议的内容。我已经读取了x86-64中原子操作，例如XCHG在独占模式下访问缓存线。 但是根据该协议，如果另一个内核对该高速缓存线中的存储器位置进行读取或写入，则该高速缓存线可以转变为共享或无效状态。那么，当内核执行原子操作时，这种情况会发生吗？它是如何预防的？
浏览 53提问于2021-07-24得票数 1
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1回答
作为一个类项目的一部分，我正在寻找在CPU架构中提高路径查找算法性能的方法。在C++中实现了该算法。基本操作是读取x，y坐标并对其执行一些操作。
我现在的想法是将x和y坐标分别存储在两个缓存组中(设置为关联)。为一个位置输入的两个坐标应该存储在不同的库中，这样它应该能够并行读取它们，并对x和y坐标进行单独的操作，并存储组合的结果。通过使用矢量运算，这个过程可以进一步加快，以便同时读取多达4x坐标和4y坐标。
例如，为了计算到目标节点的欧几里德距离，必须在每个位置读取x和y坐标，并从目标坐标中减去x和y坐标，以求出距离。
我想知道是否有一种有效的方法(缓存放置策略)来将x和y坐标保持在不同的缓存
浏览 0提问于2012-12-08得票数 1
1回答
我编写了下面的玩具基准。
int N = 1024*4096;
unsigned char *ary = malloc(N);
ary[0] = 1;
int stride, i;
double start, end;
int sum;
for(stride = 1; stride < N; ++stride) {
start = getCPUTime();
sum = 0;
for(i = 0; i < N; i+=stride) {
sum += ary[i];
}
end = getCPUTime();
pr
浏览 2提问于2013-12-23得票数 1
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我需要有关NVIDIA开普勒GPU的L2缓存的详细信息。我知道缓存的大小(例如GT740M图形处理器上的512KB )和块大小(32B)。我尝试通过一个样本内核捕获关联性、替换策略，以及更重要的映射函数(从全局地址到缓存线)，并使用nvprof profiler分析读取命中率。我意识到映射不是模运算。是否有什么技巧可以找出给定全局地址映射到哪条高速缓存线？有谁可以帮我？
浏览 0提问于2015-10-30得票数 1
我做了一个简单的折线图：
它显示了点2，9，16，23处的4条网格线，这些网格线是使用以下代码生成的：
hAxis: {
gridlines: {
count: 4
}
}
通过使用上面的代码，无论数据增加或减少多少，它都将始终显示4条网格线。
我可以以规则的步长间隔显示网格线吗？例如，在5，10，15，20时...以此类推？
浏览 1提问于2012-04-25得票数 3
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如何编写自动处理缓存线对齐的C/C++代码。
假设我们用c编写了一个结构，其中有5个成员，我们希望将这个结构成员与不同硬件X86硬件CPU中的不同高速缓存线对齐。
例如，如果我有两台X86机器Machine_1和Machine_2，Machine_1有64字节的缓存线，Machine_2有32字节的缓存线。我如何进行编码，使每个变量都对齐到Machine_1和Machine_2的不同缓存线。
struct test_cache_alignment {
int a;
int b;
int c;
int d;
int e;
};
谢谢，Abhishek
浏览 2提问于2014-06-07得票数 2
2回答
处理器A拥有与处理器B共享的高速缓存线。
当B尝试写入该行时会发生什么？
另外，如果它是“无效”而不是“共享”，会有什么不同吗？
谢谢。
浏览 1提问于2010-05-21得票数 0
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如果我有一个具有8条高速缓存线的4路组关联高速缓存，那么会有多少组线？
-I会说4组线路(每路1组线路，每组线路包含2条线路)
如果我使用4路组关联缓存并将其转换为全关联缓存，那么会有多少组行？
-我不确定.
浏览 9提问于2011-12-08得票数 1
3回答
设arr是一个16 x 20的维数组
下面是上面提到的代码片段的valgrind输出。输出来自cachegrind。
for (i = 0; i < 20; i++)
arr[0][i] = 0;
Ir I1mr I2mr Dr D1mr D2mr Dw D1mw D2mw
64 0 0 41 0 0 1 0 0
60 0 0 20 0 0 20 2 2
浏览 0提问于2010-10-26得票数 1
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1回答
在我的理解中，原子操作(例如c++原子)首先锁定缓存行，然后执行原子操作。我有两个问题: 1.假设原子比较和交换本身就是硬件中的原子操作，为什么我们需要锁定高速缓存线；2.当高速缓存线被锁定时，另一个cpu如何等待它？它是否使用了自旋锁风格的等待？ 谢谢
浏览 18提问于2019-03-09得票数 0
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2回答
当涉及到诸如MESI之类的高速缓存一致性协议时，CPU寄存器和CPU高速缓存之间是什么关系？如果某个值存储在CPU的缓存中，也存储在寄存器中，那么如果缓存线被标记为“脏”，会发生什么？据我所知，即使缓存被更新了(由于MESI)，也没有gurentee保证寄存器会更新它的值。
隐藏此代码：
static void Main()
{
bool complete = false;
var t = new Thread (() =>
{
bool toggle = false;
while (!complete) toggle = !t
浏览 0提问于2009-12-27得票数 4
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1回答
我有一个关于内存系统所遵循的策略的基本问题。
考虑一个具有私有L1和L2缓存的核心。在L2缓存之后，我们有一条总线，coherence流量在其上运行。现在，如果地址(X)的缓存线被从L2缓存中逐出，那么是否有必要从L1缓存中逐出该地址？
驱逐的原因可能是，如果l2中的一行显示无效，则它有助于维护一致性协议的不变性此核心不包含此地址。
浏览 2提问于2013-02-05得票数 6
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1回答
脏缓存行和页面回收
、、、、
当操作系统选择清除脏缓存行时，尚未写回的脏缓存行会发生什么情况(假设回写式缓存)。换句话说，当选择从主存储器中逐出一个页面时，该页面的缓存线会发生什么。
一般的假设是，当页面被从内存中逐出时，它已经足够冷，不能被缓存。然而，在更大的缓存中，这会带来问题吗？假设我们有足够的高速缓存线来容纳每页中的1条线？
浏览 0提问于2015-11-12得票数 4
我知道一个好的编译器可以执行优化，这样通过std::shared_ptr访问int*就像使用原始int*指针一样使用相同的程序集。
我的问题是:包含优化的智能指针的缓存线是否会被来自智能指针的其他数据成员污染，如引用计数器？因此，尽管生成的程序集与实际指针相同，但缓存性能可能会更差，因为没有有效利用大量的缓存线？
编辑:如果我们遍历像std::vector<std::shared_ptr<int>>这样的结构并使用int，这种性能效果可能会更明显。
浏览 1提问于2014-04-17得票数 7
我正在解决一个问题(我将在这里稍微改变一下问题，因为我更感兴趣的是有人检查我的知识)，大致是这样的：
您有三个10x20的二维数组A、B和C。它们都包含双精度浮点数。这里有一个2048行长的D-cache，每行都是256字节长。它是以行为主的顺序。
然后你就有了一些代码，它们的运行方式如下：
for(i = 0 to 9)
for(j = 0 to 19)
C[i][j] = A[i][j] + B[i][j]
A位于地址0x10014000，B位于地址0x10019000，C位于地址0x1001E000
并且该问题询问读取命中和写入未命中。
现在，据我所知，双精度浮点数是
浏览 0提问于2016-12-13得票数 1
1回答
如果我有比较和交换操作
void push(const T& data){
node * newNode = new node{data};
newNode->next = head.load();
while(!head.compare_exchange_weak(newNode->next, newNode));
}
这样的操作是否会使指针为head、newNode->next和newNode的高速缓存线锁定正在执行它的线程？
P.S.当然，如果它们存储在不同的高速缓存线
浏览 3提问于2021-08-05得票数 1
其中有几种缓存一致性协议，如MSI、MESI、MOSI、MOESI等。
让我们假设这个场景: CPU包含4核和L1专用缓存(L1缓存大小在这里并不重要)。这里的内存地址是说明性的。
Core-0请求访问内存以寻址0x1111，因此该值将从主内存加载到其L1缓存行中。
Core-1请求访问内存以寻址0x2222，因此该值将从主内存加载到其L1缓存行中。
Core-2请求内存访问地址为0x1111 (以前由Core-0访问)。此引用已加载到Core-0的缓存线中，因此缓存一致性协议将复制包含该引用的Core-0缓存线，并最终将其存储到Core-2的缓存线中。
问题1: core
浏览 4提问于2017-10-09得票数 1
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2回答
假设有两个变量存储在同一个CPU缓存线中，如果我成功地CAS其中一个变量，整个缓存线会在CAS指令之后立即更新吗？
浏览 2提问于2014-09-11得票数 3
我正试图理解在docs：中所描述的斯戴奇式均匀选择算法。
ga默认的选择函数，随机一致，列出了一条线，其中每个父对应的长度线的一段与其比例值成比例。该算法沿着等宽的步长沿直线移动。在每一步中，算法都会从它所在的部分分配一个父级。第一步是小于步长的均匀随机数。
对我自己来说，上面的文档可以用两种方式来解释：
一个随机数x将首先被选择，所有后续的“步骤”都是其中的多个。
步长:1随机x，例如0.5在线位置: 0.5，1，1.5，2，2.5
该算法以固定的步数沿直线移动，另外，每个time.Fixed步长都会添加一个随机x<固定的步长:1随机x一直在变化，但在线上的<1位
浏览 0提问于2018-08-21得票数 1
我是编程新手，正在尝试用python创建一个程序，该程序根据用户的输入创建一个带有大小的楼梯。程序应如下所示：
这是我到目前为止所拥有的代码；
steps = int(input('How many steps? '))
print('__')
for i in range(steps):
n = steps+i
print(' '*(n-2) + '|_')
print('_'*n + '|')
这就是我的输出；
注意-水平线是下划线'_‘，垂直线是竖线字符&#
浏览 0提问于2017-03-12得票数 1
这是的一种扩展。当两个线程同时写入物理内存中映射非常接近的缓存线时，计算机体系结构如何工作？似乎存在竞争条件，即两个线程在完全相同的时钟周期向同一缓存行发出写操作。在将另一个缓存线标记为过时之前，两个缓存线是否都能成功写入？如何解决这个问题，使其在功能上正确？
浏览 0提问于2019-06-08得票数 1
1回答
考虑提供CPU高速缓存线对齐的编译器选项以实现更多的高速缓存命中。但在多线程或多处理系统中，保证优化代码的高速缓存使用将在运行时获得预期的高速缓存使用，而其他进程或线程也使用相同的高速缓存。特别是，多核系统使用cpu缓存并行地提供多个CPU线程。
浏览 14提问于2018-02-10得票数 0
我正在为组装一个小补丁，它将使用完全通用的代码、CPU指令和缓存配置(目前只有x86/x64自动配置，其他架构不为非特权代码提供CPUID类型配置)进行自动检测。此代码需要完全在非特权上下文中执行，即纯用户模式代码。它还需要在非常不同的POSIX实现之间具有可移植性，所以grokking /proc/cpuinfo不能做到这一点，因为我们的目标系统中没有这样的东西。
检测CPU的频率、缓存的数量、它们的大小甚至缓存线的大小都可以使用100%的通用POSIX代码来完成，这些代码没有任何特定于CPU的操作码(只有许多合理的假设，例如，如果没有内存或寄存器依赖停顿，将两个数字相加，可能会在单个周期内
浏览 1提问于2013-03-25得票数 17
3回答
ARM ARM实际上并没有以正确的方式给出这条指令的正确用法，但我发现它在其他地方被用来知道它接受一个地址作为在哪里读取下一个值的提示。
我的问题是，给定一个256字节的ldm/stm指令的紧密复制循环，比如r4-r11 x 8，在复制之前，在每个指令对之间预取每个高速缓存线是更好，还是根本不这样做，因为所讨论的memcpy不是同时读取和写入相同的内存区域。我非常确定我的缓存线大小是64字节，但它可能是32字节-在这里编写最终代码之前等待确认。
浏览 2提问于2011-06-21得票数 4
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3回答
计算n维弧路径
、、、、
我正在为一台数控铣床实现一个驱动程序，而我在执行G代码的圆弧命令时遇到了麻烦。
我已经找到了中点圆算法的几个实现，但它并不是真正可用的。
正如我所发现的，中点圆算法的问题是它是2D的，同时绘制所有八分线，而我需要通过3D路径的顺序步骤，由起点，终点和中心点给出。
我找到了一个使用浮点运算的。也许画弧线也有类似的事情？
我也许可以通过大量的思考和实验来改变这个算法，但既然绘制圆弧不是一个无法解决的问题，而且之前已经制造了数控机床，我想知道是否已经存在一个优雅的解决方案？
浏览 3提问于2012-04-16得票数 5
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1回答
intel中的TLB结构
、、、
我从Patterson & Hennessy一书的基本定义开始，然后按照英特尔编程参考文档了解更多关于TLB的信息。
从英特尔文档中，我了解了TLB的高级设计。例如线大小、关联性和高速缓存级别。但是需要详细解释TLB高速缓存相对于高速缓存未命中及其在现代CPU中的替换机制是如何工作的。移动了哪些页面
从L1 TLB到L2 TLB？TLB中的单个条目可以寻址多少页？TLB中有多少个条目？(特别是DTLB)
任何信息或参考资料都会对我有很大帮助。(如果这不是这个问题的合适论坛，请推荐合适的论坛)
谢谢。
浏览 0提问于2016-02-22得票数 5
3回答
假设我们有两个指令Store A Store B，这两个指令映射到Cache中的两个不同的缓存线。无序退出Store (Store B而不是A)是否有助于考虑在缓存中回写分配策略？假设没有异常/中断，没有结构、控制、数据依赖性或存储器依赖性，则两个指令之间没有高速缓存冲突。
浏览 0提问于2016-03-04得票数 0
1回答
在圆上画角度线，得到相交点。
、、、、
我希望画一个圆圈的角度线(我改变了脚本中的角度)。我得到的情节线是0角，为什么脚本不向我展示所有这些，我如何修复它呢？此外，如何计算交点？
剧本：
clc;
clear;
close all;
r=1000;
% based on : https://stackoverflow.com/questions/29194004/how-to-plot-a-circle-in-matlab
nCircle = 1000;
t = linspace(0,2*pi,nCircle);
xCircle = 0+ r*sin(t);
yCircle = 0+ r*cos(t);
line(
浏览 0提问于2018-07-03得票数 1
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1回答
假设使用坐标为(X0，Y0)的点A和坐标为(X1，Y1)的点B绘制一条线，是否有一个随机算法可以用于生成位于同一条线上的A和B之间的随机点的坐标。
浏览 4提问于2016-01-08得票数 0
2回答
在阅读this问题时，我遇到了“虚假分享”和“真实分享”这两个术语。我读过什么是虚假分享，但我找不到任何关于真正分享的东西。虽然在前面提到的问题中，这个术语被描述为“建设性干扰”，但我仍然不明白它的意思。
浏览 56提问于2019-08-22得票数 8
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3回答
#include <iostream>
#include <stdint.h>
using namespace std;
struct UIContainer {
uint16_t x, y; //Position on the screen
uint16_t h, w; //Height and width of the UIContainer
uint16_t color; //Color, rgba such as 0xFF000000 & color is red, 0x00FF0000 is green, 0x0000FF00 i
浏览 1提问于2014-09-24得票数 3
2回答
据我所知，虚拟索引虚拟标记缓存，在这里我们有一个虚拟地址分为页码和页偏移量。我们使用这个页码来获取缓存块。如果存在缓存未命中，我们将使用TLB进行地址转换，并从主存中获取适当的缓存块。我的疑问是，“索引”一词在这里的意思是什么？这是高速缓存线的寻址方式吗？虚拟标记的含义是什么？
谢谢。
浏览 6提问于2017-07-07得票数 0
1回答
我在glassdoor上遇到过这个问题，但我找不到任何用实际汇编或C代码来解决它的解决方案。有谁能帮帮我吗？
浏览 2提问于2014-07-20得票数 0
2回答
我在我的iOS应用程序中使用Google Maps。它将在两个坐标之间绘制一条线，并在地图上添加起点和终点位置作为“标记”。
我使用下面的代码来添加开始和结束标记
//myLatLngArrayList is array of coordinates with latitude and longitude positions
markerA.position = (curDrill.myLatLngArrayList.first)! as CLLocationCoordinate2D
markerA.map = mapView
markerA.ico
浏览 0提问于2017-06-16得票数 0
2回答
x86操作码对齐参考和指南
、、、、
我正在JIT编译器中动态生成一些操作码，我正在寻找操作码对齐的指导原则。
1)我已经阅读了一些评论，这些评论通过在调用后添加nops来简要地“推荐”对齐
2)我还读到过使用nop来优化序列的并行性。
3)我读到过操作对齐对“缓存”性能有好处
通常，这些注释不会给出任何支持引用。阅读博客或评论说“做某事是个好主意”是一回事，但实际编写一个编译器来实现特定的操作序列并认识到大多数在线材料，尤其是博客，对实际应用是没有用处的，这是另一回事。所以我相信自己去找东西(反汇编，等等，看看现实世界的应用程序是做什么的)。这是一个我需要一些外部信息的案例。
我注意到编译器通常会在之前的指令序列之后立即开始奇数
浏览 2提问于2010-03-21得票数 4
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如果用__thread声明了一个可变或恒定大小的数组，那么后备虚拟地址范围是否可以跨线程共享一条缓存线？(例如，如果线程本地整数的两个副本位于同一缓存行上，则性能将因缓存行的反弹而受到影响。)答案取决于gcc/Linux的版本和硬件架构吗？
浏览 3提问于2016-02-08得票数 1
1回答
将缓存哪些数据？
、、、、
书中对cache的描述总是非常笼统。我是一名建筑专业的学生。我想更详细地了解cache的行为。
在c/c++语言代码中，哪些数据将从内存加载到缓存？是否会在频繁使用时将其加载到缓存中？例如，当我用C语言编写For循环时，我经常使用变量i, j, and k。这些也会被加载到缓存中吗？C语言的局部变量一般都放在堆栈区，全局变量会放在数据区吗？当它们被使用时，它们会首先被加载到缓存中吗？数据是否必须通过高速缓存才能到达寄存器，然后到达CPU？
指针变量p存储数据的地址。如果我使用指针*p来访问一个变量。是否会先将p加载到缓存中，然后再将*p加载到缓存中？
浏览 0提问于2020-12-22得票数 1
这似乎是个奇怪的问题..。
假设缓存行的大小为64字节。此外，假设L1、L2、L3具有相同的缓存线大小( post说英特尔核心i7就是如此)。
内存上有两个对象A，B，它们的(物理)地址是N个字节。为了简单起见，让我们假设A位于缓存边界上，也就是说，它的地址是64的整数倍数。
1)如果N < 64，当A被CPU获取时，B也会被读取到缓存中。因此，如果需要B，并且缓存行尚未被逐出，那么CPU将在很短的时间内获取B。每个人都很开心。
2)如果N >> 64 (即远大于64)，当A由CPU获取时，B不会与A一起读入缓存线。所以我们说"CPU不喜欢到处追逐指针“，这是避免堆分
浏览 2提问于2017-08-16得票数 5
回答已采纳
1回答
同步+异步步进步进函数
、、、
我对步长函数非常陌生，并且仍然在探索同样的方法。我有类似下面这样的工作流
--Steps A to C are synchronous.
Step A
if(respose is X)
Step B
else
Step C
--Need to return response to user here and need to follow two below steps asynchronously to unblock the caller of step function.
Step D
Step E
有没有可能实现同样的目标？我相信，我将在步骤A、B和C中添加.sync。不
浏览 2提问于2021-03-22得票数 0
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