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将自定义 IP (HDL)添加到 Vivado 模块设计(Block Design)

绪论 使用Vivado Block Design设计解决了项目继承性问题,但是还有个问题,不知道大家有没有遇到,就是新设计的自定义 RTL 文件无法快速的添加到Block Design中,一种方式是通过自定义...添加设计文件并编写自定义 RTL 不用于仿真目的的自定义 RTL(即测试文件)都被视为 Vivado 中的设计源。...将 Zynq 处理系统 IP 块添加到设计中,并运行自动设置或者自动连线。...将 RTL 模块添加到Block Design 要添加我们在上一步中创建的 D 触发器的 RTL 模块,右键单击 Diagram 窗口空白处的任意位置,然后选择Add Module...选项。...Vivado 将自动显示它在当前项目中找到的所有有效 RTL 模块。由于写入或导入到当前项目中的模块是我们刚刚设计的 D 触发器,因此它是本例中的唯一选项。

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