当我们在verilog中做latch时，我们使用阻塞还是非阻塞语句？

在Verilog中做latch时，我们通常使用非阻塞语句。

阻塞语句（blocking assignment）使用“=”符号，它会按照顺序执行，并且在当前语句执行完之前会阻塞后续语句的执行。这意味着如果使用阻塞语句来实现latch，会导致逻辑上的错误。

非阻塞语句（non-blocking assignment）使用“<=”符号，它在同一个时间步中同时执行，并且不会阻塞后续语句的执行。这使得非阻塞语句更适合用于latch的实现，因为latch需要在时钟上升沿之后才能更新其输出。

使用非阻塞语句可以确保latch在时钟上升沿之后才更新其输出，从而避免潜在的逻辑错误和冒险现象。

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