Speedcore eFPGA数据手册——第五章 Speedcore系统级调试

尊敬的工程师朋友们，

正值云计算、大数据、人工智能、区块链、智慧城市、智能汽车、新一代数据通信和移动通信快速发展之际，一大批面向全新应用的高端芯片将以ASIC或者SoC的方式不断涌现，比如数据中心或其他互联网基础设施的加速芯片、比特币矿机核心芯片、基于人工智能和边缘计算的安防等各类应用核心芯片、智能汽车和ADAS等应用数据融合处理芯片、5G标准实现和基础设施芯片等等，这些新的芯片将给广大的集成电路设计公司带来诸多机会。与此同时，这些解决方案都有一个共同点，即采用FPGA或者FPGA逻辑阵列来进行数据处理硬件加速，以及应对标准或者技术规范（如自动驾驶安全规范）的不断演进。在设计时即将FPGA逻辑阵列植入到ASIC或者SoC的嵌入式FPGA（eFPGA），正在成为未来诸多高端芯片的重要设计组成部分。

Achronix作为业内唯一提供Speedster系列高端FPGA芯片、Speedcore嵌入式eFPGA、Speedchip定制FPGA晶粒及其他器件多晶粒合封、ACE开发工具的厂商，可以帮助芯片设计公司在开发过程中实现前所未有的效率与速度。例如，在开发新一代搭载Speedcore eFPGA的ASIC或SoC的同时，芯片设计公司即可以基于Speedster FPGA芯片来开发和验证应用，或者采用Speedchip多晶粒合封的方式，与其用户展开系统初步设计和调试；而一旦搭载Speedcore eFPGA的ASIC或SoC流片成功量产，即可与客户进行系统的优化从而在性价比、功耗、体积与空间占用方面形成全面的优势。

为了便于工程师朋友们评估Speedcore eFPGA产品，现将该产品的数据手册提供给大家参考。如有任何需求或者疑问，欢迎随时与我们联系。同时，点击“阅读原文”可以了解关于Speedcore eFPGA的更多、更详细信息。

Speedcore eFPGA数据手册

第五章Speedcore系统级调试

Snapshot™是实时设计调试工具，它被嵌入在ACE软件中，为实时调试用户设计中的信号提供了一个实用平台。如需使用Snapshot功能，用户设计的RTL中应例化Snapshot宏。在例化宏并编程器件之后，用户将能够通过ACE Snapshot Debugger GUI调试设计。

在设计中进行Snapshot宏例化时，可用于作为接口连接映射到AchronixFPGA内核的任何逻辑。Snapshot在FPGA引脚上提供了一个JTAG接口，以控制/观察映射到内核的调试逻辑。这允许驱动JTAG接口的ACE Snapshot Debugger调试器GUI去控制/观察与调试逻辑相关的信号。

图14•SnapshotDebugger调试器

Snapshot宏实时对用户信号进行采样，通过JTAG接口发回捕获的数据。Snapshot支持以下功能：

—捕获高达144位宽的数据

—总是以用户时钟频率捕获1,024个采样数据

—支持多达三个独立的36位触发条件，每个触发条件都可以在任何用户信号上设置。每个触发条件都支持“忽略”功能（屏蔽）

—所有抓取的数据将通过时钟TCK以串行方式读回