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我需要用VHDL语言将50 MHz时钟分成1.5 Mhz，占空比为50%。为此，我想使用计数器来计数50兆赫时钟脉冲的数量，直到1.5兆赫兹时钟周期的一半，即16.6666，这是十进制，我不知道如何在代码中实现。有谁能帮我一下吗？
非常感谢。
浏览 4提问于2013-06-13得票数 1
我试图创建一个时钟，它只持续10个时钟周期从一个100 MHz信号。时钟将从脉冲信号中激活。-Every时间脉冲信号为1 clock2，跟随100 MHz clock1，共10个周期
我在用VHDL语言工作。
浏览 5提问于2012-09-20得票数 0
单时钟周期实现
因此，在单时钟周期实现中，即在一个时钟周期内，对一条指令执行5个阶段。例如，加载指令(它有5个阶段)在一个时钟周期内执行。因此，其他指令可以在这个时钟周期后执行。假设一个时钟周期是10秒。
现在，在流水线中，可以重叠多个指令。在上面的例子中，
浏览 1提问于2016-10-29得票数 1
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我用汇编语言编程，有一个8051微控制器，上面有一个24.5 MHz的晶体，一个时钟周期除以12。有人能帮我做这个计算吗？
谢谢。
浏览 0提问于2014-08-26得票数 0
对于由德州仪器公司生产的CC3220S，我用C编程语言开发了一个函数，它使用内联程序集等待1秒(不包括循环前和循环外的指令)。根据，针对PC机的MOV指令需要1+P指令周期，其中P在1到3之间，这取决于流水线填充。最坏的情况是，这意味着循环在6个时钟周期内执行。
CC3220S的时钟速度是80 MHz。这意味着循环使用8个时钟周期。我对指令使用的时钟周期的数量表示怀疑。因此，我的问题是，从ARM购买IP的半导体制造商
浏览 3提问于2019-12-07得票数 1
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我已经集成了一个用C语言实现的机器学习算法和一个运行在OpenModelica中的Modelica模型。这让我怀疑，为了求解模型，OpenModelica需要在每次模拟迭代中调用它几次。为什么OpenModelica会在每个时钟节拍多次调用我的算法？我如何才能解决这个问题，使学习不会同时被多个
浏览 2提问于2015-03-31得票数 2
如何在ARM11中使用性能监视器单元来计算汇编代码的执行时钟周期？
我正在使用Raspberry Pi Model B。我正在用汇编语言编程(将汇编程序作为操作系统运行)，并且想要计算执行我的代码所需的时钟周期数。
浏览 3提问于2016-06-11得票数 1
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此问题涉及使用DMA处理到达输入接口的数据在存储器中的输入和存储，使用此机制可实现的数据速率，以及用于特定数据速率的总线带宽(容量)。您可以详细了解每次DMA传输的时钟周期的执行情况，以及获取和释放总线的时钟周期。下面给出了: DMA设备在输入接口和存储器之间传输单个数据项所需的时钟周期数、获取和释放系统总线的时钟周期数、每个数据项的大小(以位为单位)以及时钟频率。每次数据传输的时钟周期</
浏览 26提问于2011-12-22得票数 1
我需要编写一段时间关键的代码(通过位爆炸实现软件协议的一个严格部分)，它使用延迟。C预处理器在编译时可以计算延迟的时钟周期数(用F_CPU宏)，所以我需要为未知的周期实现汇编程序延迟代码。但是GCC提供了非常有用的__builtin_avr_delay_cycles(unsigned long cycles)函数，它使cycles时钟周期精确地被定义为F_CPU频率。这对我不好，我需要控制每一个时钟周期。
浏览 6提问于2012-11-22得票数 0
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我用VHDL语言做了一个cpu。cpu包括alu、ram、mux和其他子模块。现在，我想将子模块的所有输入和输出值都转储到csv或vcd文件中。我想要观察假设20个时钟周期的变化。我如何在VHDL中实现它。我正在使用ModelSim进行模拟。
提前谢谢。
浏览 5提问于2021-07-16得票数 0
我所挣扎的是设计我的机器来处理需要多个时钟周期来解决的操作的最佳方法。目前，我编写的所有硬件组件只需要一个滴答就可以解决，所以这是我遇到问题的控制单元。例如，假设我的机器的所有操作都需要1到3个时钟周期来完成，这意味着我需要对每条指令都有3个周期(因为我现在不做任何并行操作)。这将意味着我需要对我的机器进行三个阶段，或者用HDL语言来说，需要三个时钟敏感逻辑块。机器的一个完整的迭代看起来如下：
滴答:
浏览 5提问于2017-02-20得票数 0
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目前，我正试图在同一环境中测量两种不同编程语言完成一项操作所需的时钟周期数。(不使用操作系统) return ((u64) lo) | (((u64) hi) << 32);根据rdtsc在手术前后的差异，应提供时钟周期的数目operation
浏览 2提问于2015-11-25得票数 2
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我偶然阅读了英特尔体系结构参考手册，当我阅读指令延迟和吞吐量附录时，我发现延迟(执行核心完成所有形成指令的μ操作的执行所需的时钟周期数)。sqrt指令的延迟与divide (在C-28页)指令的延迟完全相同--至少对于某些微体系结构是这样。对于单精度、双精度和扩展精度，这些数字分别为30、40和44个时钟周期。我一直认为sqrt指令在任何语言中都是昂贵的。
浏览 4提问于2013-02-16得票数 2
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我遇到了一些术语，比如时钟节拍，时钟周期和时钟速度，我发现这些术语很难理解。如果有人能用一种简单的语言来澄清这一点，我将非常感谢。提前感谢！
浏览 11提问于2017-04-27得票数 44
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组合逻辑时序
、、
我目前正试图在一个时钟周期内实现一个数据路径，该路径计算以下内容。
signal shift_out : std_logic_vector (7 downto 0);
浏览 5提问于2013-11-24得票数 0
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什么是机器循环？
、、、
我有点搞不懂“机器周期”的确切定义。
CPU对每种机器语言指令执行的四个步骤:提取、解码、执行和存储。每个阶段都需要几个时钟周期。Z80在一个或多个逻辑周期中执行每个阶段，称为“机器循环”。现在让我困惑的是--据我所理解--第一个基本意思是:机器周期是一个提取解码执行周期，而书中基本上是这样说的:机器周期是在每个提取、解码或执行周期individually__.中发生的一个或多个时钟</em
浏览 0提问于2016-08-06得票数 5
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在我的应用程序中，我需要用C语言生成一个函数，它将提供以纳秒为单位的特定时间延迟。此延迟计时器必须在软件中完成，因为我的AVR MCU中没有任何硬件计时器。我的问题是，我希望能够以纳秒为单位设置该值。我的MCU时钟是20 MCU (50nS周期)。我想了一个快速的"for“循环，就像；但这不会考虑到在编译时每次在循环周围添加多少个周期。我真的不想用汇编语言写代码。
浏览 0提问于2019-05-10得票数 2
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问题来自于RISCV实现，但我认为它可能也适用于许多其他体系结构。来自具有两个完全独立指令的代码(通用ISA表示法)：REG4 = REG5 + REG6
在流水线实现中，假设没有其他危险(同时访问寄存器并有两个独立加法器)，如果这两个指令完全并行执行换句话说，在同一时钟边缘，三个寄存器(REG1、REG4和PC)能否同时更新( RISCV-32示例的PC+8)？
浏览 2提问于2022-01-07得票数 0
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控制执行速度
、、
为了公平起见，每个bot程序都应该以相同的速度执行，因此使用本机预编译的C/C++代码似乎是不可能的。我能想到三个选择，但我不确定大约有两个：
问题: JVM“时钟”能否被控制，告诉它运行X时钟周期值的代码？使用脚本语言- Bots可以用JS或之类的语言</em
浏览 9提问于2012-10-30得票数 1
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